译码器 目录 原理 功能表 行选择 指令译码器 参见 导航菜单编

数字电子


电子技术组合逻辑电路二进制代码逻辑电平编码器BCD多输入多输出逻辑门多路复用七段数码管内存与门与非门二进制位随机存取存储器地址总线行地址选择CPU设计CPU指令寄存器微程序寄存器文件ALU











公共汽车标牌上的红色七段数码显示器即为最常见的一种数字显示译码器


译码器是电子技术中的一种多输入多输出的组合逻辑电路，负责将二进制代码翻译为特定的对象（如逻辑电平等），功能与编码器相反。译码器一般分为通用译码器和数字显示译码器两大类。


数字电路中，译码器（如n线－2n线BCD译码器）可以担任多输入多输出逻辑门的角色，能将已编码的输入转换成已编码的输出，这里输入和输出的编码是不同的。输入使能信号必须接在译码器上使其正常工作，否则输出将会是一个无效的码字。译码在多路复用、 七段数码管和内存地址译码等应用中是必要的。




目录





  • 1 原理


  • 2 功能表


  • 3 行选择


  • 4 指令译码器


  • 5 参见




原理


译码器可以由与门或与非门来负责输出。若使用与门，当所有的输入均为高电平时，输出才为高电平，这样的输出称为“高电平有效”的输出；若使用与非门，则当所有的输入均为高电平时，输出才为低电平，这样的输出称为“低电平有效”的输出。




2线－4线一位译码器


更复杂的译码器是n线－2n线类型的二进制译码器。这类译码器是一种组合逻辑电路，能从已编码的n个输入，将二进制信息转换为2n个独特的输出中最大个数的输出。我们说2n个输出的最大个数，是因为当n位已编码信息中有未使用的位组合时，译码器可能会有少於2n个输出。


译码器包括2线－4线译码器、3线－8线译码器或4线－16线译码器。在有使能信号输入的情况下，2个2线－4线译码器可以组成1个3线－8线译码器，同样，2个3线－8线译码器可以组成1个4线－16线译码器。在这类电路设计中，2个3线－8线译码器的使能输入都来自於第四个输入端，这一输入在2个3线－8线译码器间起到了选择器的作用t。这使得第四个输入端可以使2个译码器中的任何一个工作，其中第一个译码器产生输出D(0)至D(7)，第二个译码器产生输出D(8)至D(15)。包含使能输入的译码器又称译码器－多路分配器。因此，将第四个输入端作为2个译码器共享的输出就能组成1个4线－16线译码器，能产生16个输出。



功能表




3线－8线译码器


  • 输入：s0，s1，s2

  • 输出：最小项m0，m1，…，m7




行选择





Athearn火车头中的Digitrax DH163AT DCC（英语：Digital Command Control）译码器，安装外壳前。


大多数随机存取存储器使用n线－2n线译码器来将地址总线上已选择的地址转换为行地址选择线中的一个。



指令译码器


在CPU设计中，指令译码器是CPU的一部分，能将存储在指令寄存器或微程序指令中的位元转换为能控制CPU其他部分的控制信号。


8个寄存器组成的简单CPU会使用指令译码器中的3线－8线逻辑译码器来选择寄存器文件的源寄存器并输出到ALU以及目的寄存器中，以接受ALU的输出。典型的CPU指令译码器也包括其他很多组件。



参见


  • Endec

  • 优先编码器








  • 查

  • 论

  • 编


数字电路

概念

数字信号 · 布尔代数 · 開關 · 组合逻辑电路 · 时序逻辑电路（同步 · 異步） · 真值表 · 卡诺图 · 有限状态机（米利机 · 摩尔机）
硬件模块

邏輯閘（与 · 或 · 非 · 同 · 与非 · 或非 · 异或 · 同或 · 蘊含） · TTL · CMOS · 加法器 · 乘法器 · 编码器 · 译码器 · 数据选择器 · 锁存器 · 寄存器 · 触发器（D · T · RS · JK） · 儲存裝置（ROM · RAM） · 類比數位轉換器 · 數位類比轉換器

IC、VLSI

定制程度（半、全）、PLD（PAL · PLA · GAL · CPLD · FPGA） · ASIC · 设计 · 验证 · 电子设计自动化 · 硬件描述语言（Verilog · VHDL） · 逻辑综合 · 硬件验证语言（SystemVerilog）

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